exception processing中文是什么意思

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中文翻译
造句

异常处理

exception n. 1.例外；除外，除去。 2.【法律】抗告；异议，不 ...
process vi. 〔口语〕排队走，列队行进〔procession ...
exception processing descriptor segment 异常处理描述符段; 异常处理描述符区段
exception n. 1.例外；除外，除去。 2.【法律】抗告；异议，不服，反对。 Every rule has its exceptions. 任何规则均有例外。 by way of exception 作为例外。 liable [subject] to exception 容易遭到反对的，会引起异议的。 make an exception of 把…作为例外。 make no exceptions 一视同仁，一样看待。 take exception 1. 反对，表示异议。 2. 有反感。 take exception at 发怒，生气。 take exception to [against] 对…提出异议。 without exception 一概，全都；无例外地。 with the exception of 除…外。 adv. -ally ,-less adj. 无例外的。
exception or 例外或
exception to 对于...是个例外; 例外情况
no exception 没有例外，无一例外
with the exception 除了情况
with the exception of 除...外，毫无疑问，毫无异议; 除以外; 除之外; 除此之外; 除了…，除…之外; 除了情况; 除去…
with the exception of this 除此而外
exception handling exception item 异常项
above exception 无可非议的
access exception 存取异常
addressing exception 寻址故障; 寻址异常
an exception 一次例外
arithmetic exception 算术例外; 算术异常
automatic exception 自行抗告
beyond exception 无可非议地
by way of exception 作为例外
catching exception 捕捉异常
checked exception 被检查的异常; 可控式异常
control by exception 例外控制
cultural exception 文化例外
data exception 数据异常
description exception 申述异常

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例句与用法

Shows event exception processing for deadlocks
展示了针对死锁的事件异常处理。
Exception processing is monitoring for those situations which indicate an abnormal problem , or an unusual situation that warrants attention from the dba
异常处理是对那些会指出反常问题的状况或者值得dba注意的不寻常状况的监控。
If an exception process occurs or can t complete the transaction with any one of the third party providers , the web service has to make sure to go back to the previous state
如果发生异常事件或是不能与任一个第三方完成事务， web服务必须保证能回到前一个状态。
A series of basic functions are performed in the chapter 4 , includes microengine initialization , packet receive processing , exception process , mac and ip header processing , ip forwarding , and packet transmit processing , etc . these functions build a basic data path for the whole system
第四章中实现一系列最基本的功能，包括微引擎初始化，包接收处理，异常处理， mac及ip头部处理， ip转发以及包发送处理等。这些功能为整个系统建立起一条基本的数据通路。
The paper elaborates risc technology characteristic and 5 - stage pipeline architecture and function of the 64 - bit risc cpu , and dwells on 64 - bit vega cpu characteristic , and details the eda technology and the main flow of asic design , and elaborates the operation and exception process of the vega cpu and virtual instruction address " architecture and generation , and details cache architecture and mmu . the master dissertation dwells on virtual address translating into physical address , instruction cache finding address and instruction fetching , too
详细的阐述了64位vegacpu的特点，阐述了eda技术和asic设计的主要流程，阐述了vegacpu流水线结构、流水线操作、流水线暂停和异常处理，虚拟指令地址的结构和产生， mmu结构，包括指令tlb结构和虚拟指令地址向物理指令地址的生成流程， cache结构，寻址原理和指令的写策略，指令高速缓存的寻址原理和结构，以及指令的获取流程。

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Last modified time:Tue, 12 Aug 2025 00:29:56 GMT